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鎖相迴路電路是IC設計之主要智財(IP)，不管是數位的CPU 或 memory chip，亦或是射頻傳收器都需要鎖相迴路之相關電路。 有鑑於此，經濟部工業局委託台大電機系教授群與慶齡中心共同執行『鎖相迴路電路設計』，由台大電機系教授李泰成老師規劃課程培訓時數6小時，本課程中將介紹電子系統中鎖相迴路相關電路，包括clock generation, RF frequency synthesizer, clock-and-data recovery circuit，提供進階類比IC設計技術，鎖相迴路電路設計考量，可提供有志於類比IC工程師多元的選擇並加強設計功力，提昇職場競爭力。 課程大綱：
1. PLL fundamental
2. PLL and DLL loop dynamic analysis
3. RF frequency synthesizer and CDR
4. Building Blocks
5. Case Study 上課時間：7/18(六) 9:00-12:00 & 13:00-16:00 共計:6小時。
上課地點：台大嚴慶齡工業研究中心 / 106台北市大安區基隆路三段130號 招生對象：從事與半導體產業相關之在職人才。 招生人數：每班預計招收30名(最低開課人數：10名) 課程網頁：
http://www.tl.ntu.edu.tw/online_showdetail_view.asp?ID=934&recorder=CLS20090424152905KD1
- 新聞稿有效日期，至2009/07/04為止
聯絡人 ：張小姐
聯絡電話：02-23628136#46
電子郵件：dorothy@tl.ntu.edu.tw
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